DDR5 ist die neueste Generation von DDR-SDRAM-Speicher und wurde 2020 von JEDEC standardisiert. Als Nachfolger von DDR4 bietet DDR5 die doppelte Bandbreite, höhere Speicherdichten und integrierte Fehlerkorrektur (On-Die ECC) – ideal für Data Centers, High-Performance Computing, AI- und High-End-Industrie-Anwendungen.
DDR5 verfügt über eine neue Funktion namens Decision Feedback Equalization (DFE), die Eingangs- und Ausgangsgeschwindigkeit zu skalieren, was eine wesentlich höhere Bandbreite bei geringerem Stromverbrauch erzielt.
Memphis bietet DDR5-Komponenten von Samsung, SK Hynix und Nanya für Server, Workstations und Industrial-Systeme der nächsten Generation.
Benötigen Sie DDR5 für Ihr Data-Center-, HPC- oder High-End-Projekt? Unser Team berät Sie gerne zu Verfügbarkeit, Spezifikationen und Herstelleroptionen.

• Höhere Bandbreite: High-Speed-Performance für datenintensive Workloads
• On-Die ECC: Integrierte Fehlerkorrektur für höhere Datenintegrität, höhere Zuverlässigkeit für Business-Critical-Systeme
• Energieeffizienz: 8% niedrigerer Stromverbrauch bei doppelter Bandbreite
• Zukunftssicher: Standard für Next-Gen-Prozessoren (Intel Alder Lake+, AMD Ryzen 7000+)
Speichergröße: 16Gb - 64Gb
Geschwindigkeit: bis zu 6400MHz
Betriebstemperatur: kommerzielle und industrielle Temp.
Organisation: x8, x16
Versorgungsspannung: 1,1V
Gehäuse: FBGA78, FBGA82, FBGA 106


| Spezifikation | DDR4 | DDR5 |
|---|---|---|
| Datenrate | 2133-3200 MT/s | 4800-6400 MT/s |
| Bandbreite (64-bit) | 25,6 GB/s | 51,2 GB/s |
| Spannung | 1,2V | 1,1V |
| Max. Density pro Die | 16Gb | 64Gb |
| Banks | 16 | 32 |
| On-Die ECC | Nein | Ja |
| DIMM-Architecture | Single-Channel | Dual-Sub-Channel |
| DIMM-Pins | 288 | 288 (nicht kompatibel!) |
DDR5 bietet fundamentale Verbesserungen:
DDR5 ist die erste Wahl für High-Performance-Anwendungen:
KI-Workloads benötigen massive Bandbreite:
Industrial-PCs für anspruchsvolle Anwendungen:
DDR5 (Double Data Rate 5) wurde im Juli 2020 von JEDEC als JESD79-5 standardisiert. Erste kommerzielle Produkte kamen 2021 auf den Markt. DDR5 bietet signifikante Verbesserungen gegenüber DDR4 in Performance, Kapazität und Zuverlässigkeit.
On-Die ECC ist eine integrierte Fehlerkorrektur direkt im DDR5-Chip:
On-Die ECC ist NICHT das gleiche wie DIMM-ECC:
On-Die ECC macht DDR5 zuverlässiger als DDR4.
Nein, DDR5 ist NICHT kompatibel mit DDR4:
Ein Upgrade auf DDR5 erfordert DDR5-kompatible CPU (Intel 12th Gen+, AMD Ryzen 7000+) und Motherboard.
Selbst bei Plattformen wie dem Intel Adler Lake, die offiziell sowohl DDR4 als auch DDR5 unterstützen, ist jeweils nur eine Speicherarchitektur aktiv. DDR4 und DDR5 unterscheiden sich grundlegend in der Kanalarchitektur (1×64 Bit vs. 2×32 Bit), der Stromversorgung (Mainboard-VRM vs. PMIC auf dem DIMM), den I/O-Spannungen, Terminierungskonzepten, Mode-Registern sowie den Initialisierungs- und Trainingsabläufen. Die PHYs sind unterschiedliche Designs mit jeweils eigenen analogen Frontends, DLL/PLL-Konfigurationen und Equalization-Mechanismen.
Ein DDR4-Controller kann daher nicht einfach per „Firmware-Upgrade“ zu DDR5 werden – die dafür notwendige analoge PHY- und Power-Infrastruktur ist physisch nicht vorhanden. Auch auf Leiterplattenebene werden Routing, Stack-up und PDN separat für DDR4- und DDR5-Varianten ausgelegt.
DDR5 erhöht die Datenraten auf 4800–7200+ MT/s und reduziert damit das Datenauge und die Timing-Margen erheblich. Zu den zentralen Herausforderungen zählen:
Das Routing erfordert verlustarme Materialien (z. B. Megtron 6), mehr Lagen und ein sehr präzises Referenzflächen-Design. Schon kleine Fehler im Stack-up oder Via-Design können zu Trainingsfehlern oder grenzwertiger Stabilität bei hohen Datenraten führen.
DDR4-Training konzentriert sich hauptsächlich auf Write-Leveling, Read-Centering und eine grundlegende Impedan- Kalibrierung. DDR5-Training ist dagegen mehrstufig und umfasst unter anderem: PMIC-Aktivierung, Kommunikation mit dem SPD-Hub (häufig über I3C), CA-Training, WCK-Ausrichtung, Bit-weise Deskew, DFE-Tuning sowie teilweise dynamisches Retraining über Temperatur und Spannung hinweg.
Plattformen wie Intel Sapphire Rapids oder AMD Genoa integrieren die Trainings-Firmware direkt im PHY. BIOS/UEFI stößt beim Booten komplexe Sequenzen an, und Microcode-Updates können das Trainingsverhalten erheblich verändern. Das erhöht sowohl die Komplexität als auch die Optimierungsmöglichkeiten, macht DDR5 aber auch deutlich sensibler gegenüber der Firmware-Qualität.
Höhere Datenraten bei gleichzeitig niedrigeren Spannungen bedeuten deutlich kleinere Timing- und Spannungsreserven. Ein kurzfristiger Spannungseinbruch von nur 10–15 mV auf VDDQ oder VDD2 kann das Signalauge so weit verengen, dass Bitfehler oder Trainingsprobleme auftreten. DDR5-PMICs reduzieren zwar lokale Störungen, können aber bei unzureichender Entkopplung selbst zusätzliche Schaltartefakte erzeugen.
In der Praxis äußert sich das unter anderem durch:
Für OEMs ergeben sich drei typische Wege:
Jeder Pfad bringt neue Layout-Regeln, oft neue Packages und zusätzlichen Qualifizierungsaufwand mit sich. Entscheidend sind Lifecycle-Anforderungen, Leistungsbedarf und Re-Zertifizierungskosten.
Die Migration auf DDR5 und LPDDR5(X) ist nicht nur eine technische, sondern auch eine strategische Entscheidung. Zwar steigen die Kosten zunächst, dafür bieten moderne Speichertechnologien deutlich bessere Performance, Energieeffizienz und langfristige Verfügbarkeit.
Wir empfehlen folgende Schritte:
Je früher diese Schritte erfolgen, desto geringer ist das Risiko durch Legacy-Preisschocks und kurzfristige Re-Designs.
In neuen Serverdesigns ist DDR5 bereits gesetzt. Zentrale Plattformen wie AMD EPYC Genoa/Bergamo und Intel Sapphire Rapids/Granite Rapids sind ausschließlich auf DDR5 ausgelegt. Hyperscaler befinden sich mitten im Rollout
DDR4-Server werden zwar noch einige Jahre in kosten- oder legacy-sensitiven Umgebungen ausgeliefert, aus Design- und Investitionssicht gelten DDR4-Server für Neuentwicklungen jedoch bereits heute als „Legacy“. Ab etwa 2027 werden die meisten neuen Serverprojekte standardmäßig auf DDR5- bzw. HBM-Ökosysteme setzen.
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